一种继电保护测试仪内部插件间的高速通讯电路模块制造技术

本发明专利技术一种继电保护测试仪内部插件间的高速通讯电路模块涉及电力系统继电保护测试仪领域。电力系统继电保护测试仪由数据处理插件、测试信号产生插件和其它插件组成。当前，数据处理插件与测试信号产生插件之间的通讯速度较小，测试信号的路数较少，不符合继电保护测试仪的发展趋势。本发明专利技术为数据处理插件与测试信号产生插件之间的通讯设计了一系列电路模块，该模块能使通讯速度较快、电磁兼容性较好、占用资源较少，可以满足各种配置下继电保护测试仪的要求。这一系列电路模块，包括高速RAM模块、并转串模块和LVDS接口模块。在数据处理插件与测试信号产生插件之间，采用LVDS差分线连接。对LVDS差分线两端的连接器采用金属锚定以确保连接可靠，并带屏蔽以防止电磁干扰。

A High Speed Communication Circuit Module between the Internal Plug-ins of Relay Protection Tester

【技术实现步骤摘要】
一种继电保护测试仪内部插件间的高速通讯电路模块
本专利技术涉及电力系统继电保护测试仪领域，特别涉及到测试仪内部插件间的通讯应如何设计才能使得通讯速度更高、通讯配置更灵活和占用资源更少。
技术介绍
如图1所示，电力系统继电保护测试仪由数据处理插件、测试信号产生插件和其它插件组成。数据处理插件是很复杂的，内有CPU、FPGA、SDRAM等各种各样器件。数据处理插件在其CPU等的控制下产生大量的数据。该数据首先保持在RAM中。然后在适当的时候将这些数据发往测试信号产生插件。最后测试信号产生插件负责根据传送来的数据在预定时间和预定输出接口上产生合格的测试信号。数据处理插件与测试信号产生插件之间的通讯信号常采用TTL或CMOS型信号。电力系统继电保护测试仪中，常需要采用并转串电路同步输出模块。常见的一种并转串电路同步输出模块如图2和图3所示。并转串模块的输入有：8位来自RAM的并行数据线dat[7:0]、计时信号cnt[3:0]、和cnt[4]。输出信号有4个通道的串行信号rm[0]、rn[0]、ri[0]、rj[0]。cnt[1:0]同时也是数据选择开关。dat[7:0]是4分时。由图3可见：在CNT[2:0]等于0或4时dat[7:0]的值为Vm[7:0]；在CNT[3:0]等于4至11时rm[0]分别为Vm0至Vm7；依次类推。各输出通道都是在CNT[3:0]等于4时输出并行数据的最低位，这就是同步输出。对应图2和图3的并转串模块编程语句如下，采用Altera类型芯片时占用的资源是25个LE：其中：cnt[4]为定时信号，在cnt[1:0]等于3时为1,在cnt[1:0]等于0、1或2时为0；lm[3:0]、ln[3:0]、li[3:0]、lj[3:0]、rm[2:1]、rn[2:1]、ri[2:1]、rj[2:1]为中间寄存器。
技术实现思路
电力系统继电保护测试仪的发展趋势是：需要输出测试信号的路数越来越多，每路包含的数据组数也越来越多，数据总量越来越大了。当前继电保护测试仪的问题是：数据处理插件与测试信号产生插件之间的通讯速度总量较小，测试信号的路数较少，每路包含的数据组数较少，不符合继电保护测试仪的发展趋势。如采用TTL或CMOS型等信号，通讯速度总量还受到电磁兼容方面的限制，本专利技术的目的是：为数据处理插件与测试信号产生插件之间的通讯设计一系列电路模块，该模块能使通讯速度较快、电磁兼容性较好、占用资源较少、成本较低，以满足对各种配置下的继电保护测试仪的要求。本专利技术的技术方案是：为数据处理插件与测试信号产生插件之间的通讯设计一系列电路模块，它包括高速RAM模块、并转串模块和LVDS接口模块，如图4所示；在数据处理插件与测试信号产生插件之间，采用LVDS差分线连接；对LVDS差分线两端的连接器采用金属锚定以确保连接可靠；并带屏蔽以防止电磁干扰。数据处理插件与测试信号产生插件之间的LVDS差分线数量，可以灵活配置，以满足不同配置继电保护测试仪的要求。本专利技术的LVDS差分线数量最多为8对，即最多8个通道；每对LVDS最高通讯速率为每秒500兆。LVDS通道上的信息采用以帧为单位的差错控制传输；每帧内容包括帧同步码，循环码校验信息等。本专利技术的各LVDS上的帧发送为同步发送，即在同一时刻发送各LVDS上的帧同步码。每对LVDS通道可以传输多组测试信号。数据处理插件采用FPGA芯片承担把数据发送到测试信号产生插件的主要工作。首先把需要发送的数据写入到双口RAM块中，写入时钟速率最高达125兆Hz。上述数据是以帧为单位存放在双口RAM块中；每帧信息可以根据不同配置发送到不同的LVDS通道上。然后，从双口RAM块读出数据并发送到并转串模块。再后，把并转串模块的输出数据传送到LVDS接口模块。最后，LVDS接口模块把并转串模块送来的各帧数据打包，并同步发送到测试信号产生插件的通讯接口模块。高速RAM模块和并转串模块如图5所示。其中的双口RAM块存储4个通道的各帧数据，在地址选择信号的控制下依次输出到并转串模块。并转串模块把并行输入信号转换成4个通道的串行输出信号。并转串模块全部四个通道的输出信号是同步的，各帧的第1位数据是同时输出的。并转串模块的输入和输出信号速率最高达125兆Hz。并转串模块输入信号为8位且采用Altera类型芯片时，并转串模块占用的资源较少，为16个LE。LVDS接口模块的输入包括：来自并转串模块输出的4个信号、若干定时信号和若干控制信号；输出是一对高速lvds差分信号。因为并转串模块的输出信号是同步的，因此LVDS接口模块的4个输入信号可以来自不同的并转串模块，取决于继电保护测试仪的配置情况。假设输入信号速率为125兆Hz，则输出信号速率为500兆Hz。本专利技术的有益效果为：数据处理插件与测试信号产生插件之间的通讯采用LVDS差分信号来连接，传输数据量很大，距离较长，且需要满足电磁兼容的要求；LVDS通道最多为8对，每对最高通讯速率为每秒500兆位；各LVDS通道上的信息都采用以帧为单位来进行差错控制传输，保证了传输可靠；由于继电保护测试仪需要用到最多几十个并转串模块，因而对各LVDS通道上的传输采用同步传输方式以及在并转串模块中优化使用中间寄存器就显著减少了占用的资源；LVDS接口模块的4个输入信号可以来自不同的并转串模块，通讯配置灵活；并转串模块输出全部4个信号都是同步传输，每个信号串行通讯速率最高每秒125兆Hz。附图说明图1是电力系统继电保护测试仪组成框图。图2是电力系统继电保护测试仪中的并转串模块框图。图3是并转串模块输入输出关系表。图4是继电保护测试仪插件间通讯的电路框图。图5是高速RAM模块和并转串模块框图框图。具体实施方式在数据处理插件与测试信号产生插件之间的通讯设计了一系列电路模块，包括高速RAM模块、并转串模块和LVDS接口模块，如图4所示；并且在数据处理插件与测试信号产生插件之间采用LVDS差分线连接，对LVDS差分线两端的连接器采用金属锚定以确保连接可靠；并带屏蔽以防止电磁干扰。采用LVDS差分线在通讯速度、电磁兼容性等方面优点明显，但也需要增加与其相对应的电路模块。数据处理插件与测试信号产生插件之间的LVDS差分线数量最多为8对，每对最高通讯速率为每秒500兆位，足以满足各种配置下对继电保护测试仪的要求。LVDS通道上的信息以帧为单位来传送；每帧内容包括帧同步码，循环码校验信息等。各LVDS上的帧发送为同步发送，即在同一时刻发送各LVDS上的帧同步码。采用同步发送的原因是：各LVDS的发送模块能够公用大部分定时等控制电路，因而大大减少占用的资源。FPGA芯片首先把需要发送的数据写入到双口RAM块中，写入时钟最高达125兆Hz。上述数据是以帧为单位存放在双口RAM块中。然后，从双口RAM块读出数据并发送到并转串模块。再后，把并转串模块的输出数据传送到LVDS接口模块。最后，LVDS接口模块把并转串模块送来的各帧数据打包，并同步发送到测试信号产生插件的通讯接口模块。本专利技术设计了一个定时用的计数器模块，其输入时钟最高达125兆Hz。该模块输出信号包括cnt[2:0]和cnt[4]。cnt[2:0]值为0至7，循环不息。cnt[4]在cnt[1:0]等于3输出1值，其它输出本文档来自技高网...

【技术保护点】
1.一种继电保护测试仪内部插件间的高速通讯电路模块，电力系统继电保护测试仪由数据处理插件、测试信号产生插件和其它插件组成,数据处理插件在其CPU等的控制下产生大量的数据,该数据首先保持在RAM中,然后在适当的时候将这些数据发往测试信号产生插件,最后测试信号产生插件负责根据传送来的数据在预定时间和预定输出接口上产生合格的测试信号,数据处理插件与测试信号产生插件之间的通讯信号常采用TTL或CMOS型信号,这种数继电保护测试仪内部插件间的高速通讯电路模块的特征在于：数据处理插件与测试信号产生插件之间的通讯由一系列电路模块实现，包括高速RAM模块、并转串模块和LVDS接口模块，在数据处理插件与测试信号产生插件之间采用LVDS差分线连接，对LVDS差分线两端的连接器采用金属锚定以确保连接可靠，并带屏蔽以防止电磁干扰。

【技术特征摘要】
1.一种继电保护测试仪内部插件间的高速通讯电路模块，电力系统继电保护测试仪由数据处理插件、测试信号产生插件和其它插件组成,数据处理插件在其CPU等的控制下产生大量的数据,该数据首先保持在RAM中,然后在适当的时候将这些数据发往测试信号产生插件,最后测试信号产生插件负责根据传送来的数据在预定时间和预定输出接口上产生合格的测试信号,数据处理插件与测试信号产生插件之间的通讯信号常采用TTL或CMOS型信号,这种数继电保护测试仪内部插件间的高速通讯电路模块的特征在于：数据处理插件与测试信号产生插件之间的通讯由一系列电路模块实现，包括高速RAM模块、并转串模块和LVDS接口模块，在数据处理插件与测试信号产生插件之间采用LVDS差分线连接，对LVDS差分线两端的连接器采用金属锚定以确保连接可靠，并带屏蔽以防止电磁干扰。2.根据权利要求1所述的一种继电保护测试仪内部插件间的高速通讯电路模块，其特征在于，数据处理插件与测试信号产生插件之间的LVDS差分线数量，最多为8对，每对最高通讯速率为每秒500兆，对LVDS通道上的信息以帧为单位来进行差错控制传输，每帧信息包括帧同步码，循环码校验信息等，各LVDS上的帧发送为同步发送。3.根据权利要求1所述的一种继电保护测试仪内...

【专利技术属性】
技术研发人员：夏瑞华，龚萍，胡鹏涛，俞子聪，张泉，朱永强，
申请(专利权)人：华北电力大学，
类型：发明
国别省市：北京,11