A low noise PLL source switch includes a first charge pump, PMOS tube, second PMOS tube, a first current source, third PMOS tube, fourth PMOS tube and the fifth PMOS tube, sixth PMOS tube, NMOS tube, the first second NMOS tube, second current source and third NMOS tube, fourth NMOS tube, fifth NMOS among them, fifth tube, PMOS tube gate terminal receives a first pulse signal is connected with the drain source, drain shorted and third PMOS tube; Sixth PMOS tube gate terminal receives a first pulse signal source receiving 1/2 times the supply voltage, drain and drain pipe is connected with the end of third PMOS; fifth NMOS the gate terminal receives a second pulse signal of the inverting pulse, drain connected to source, drain and short circuit and third NMOS tubes. The phase locked loop low noise source switch charge pump of the invention can be applied to low voltage applications, and it can cancel the noise generated by charge sharing of switch tubes.
【技术实现步骤摘要】
一种锁相环低噪声源端开关电荷泵
本专利技术涉及锁相环
,特别是涉及一种锁相环低噪声源端开关电荷泵。
技术介绍
锁相环(PLL,PhaseLockLoop)能够产生一个和输入参考时钟在频率和相位上保持一致的时钟,被广泛应用于同步应用中。电荷泵式锁相环(CPLL)凭借其高速、低功耗、频率捕获范围宽、低成本的优势被广泛应用。图1为现有技术中常见的电荷泵式锁相环的电路原理图,如图1所示,电荷泵式锁相环由鉴频鉴相器(PFD)、电荷泵(CP)、环路滤波器(LPF)、压控振荡器(VCO)和分频器(Divider)这五部分构成。其中,电荷泵(CP)将鉴频鉴相器(PFD)输出的误差脉冲(UP、DN)转换为误差电流,再通过环路滤波器(LPF)积分后生成控制电压使压控振荡器(VCO)产生跟随参考时钟频率的时钟。电荷泵(CP)是锁相环(PLL)的重要组成部分,电荷泵(CP)中电流源的开关引入的非理想效应会严重影响锁相环(PLL)的性能。根据电荷泵(CP)中开关的位置的不同,常见的电荷泵主要分为:开关在栅端的电荷泵、开关在漏端的电荷泵、开关在源端的电荷泵。电荷泵(CP)中的开关根据脉冲信号UP、DN进行开关动作,并且可以采用MOS管作为开关。图2-图4分别为现有技术中常见的栅端、漏端、源端开关电荷泵的电路原理图,其中,图3-4中的漏端、源端开关电荷泵更适合于高速应用。图3中的漏端开关电荷泵,在开关动作期间,作为电流源的MOS管会存在从线性区到饱和区的转换,从而产生电流突波,增加输出信号Vctrl的波动。为了减少开关动作引起的电流突波,在漏端开关电荷泵中增设了缓冲器,图5为现有 ...
【技术保护点】
一种锁相环低噪声源端开关电荷泵,其特征在于,包括:第一PMOS管、第二PMOS管、第一电流源、第三PMOS管、第四PMOS管、第五PMOS管、第六PMOS管,第一NMOS管、第二NMOS管、第二电流源、第三NMOS管、第四NMOS管、第五NMOS管,其中,所述第五PMOS管的栅端接收第一脉冲信号,源端、漏端短接并与所述第三PMOS管的漏端相连;所述第六PMOS管,其栅端接收所述第一脉冲信号,其源端接收1/2倍电源电压,其漏端与所述第三PMOS管的漏端相连;所述第五NMOS管,其栅端接收第二脉冲信号的反相脉冲,其源端和漏端短接,并与所述第三NMOS管的漏端相连。
【技术特征摘要】
1.一种锁相环低噪声源端开关电荷泵,其特征在于,包括:第一PMOS管、第二PMOS管、第一电流源、第三PMOS管、第四PMOS管、第五PMOS管、第六PMOS管,第一NMOS管、第二NMOS管、第二电流源、第三NMOS管、第四NMOS管、第五NMOS管,其中,所述第五PMOS管的栅端接收第一脉冲信号,源端、漏端短接并与所述第三PMOS管的漏端相连;所述第六PMOS管,其栅端接收...
【专利技术属性】
技术研发人员:王慧,项骏,赵庆中,刘寅,
申请(专利权)人:北京华大九天软件有限公司,
类型:发明
国别省市:北京,11
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