The invention relates to a universal input and output timing processor time sequence of input and output control method, by bus bridge, processor registers, timing control state machine, timing counter, timing, string and conversion RAM memory controller, the processor register stack includes a plurality of sequence control registers. The beneficial effects of the invention are: to achieve a general, which supports a variety of digital input and output port timing change requirements, all kinds of digital interface protocol to cope with complex and changeable; reduce the chip development cycle; low power consumption.
【技术实现步骤摘要】
一种通用输入输出时序处理器及时序输入输出控制方法
本专利技术涉及处理器
,具体的说是一种通用输入输出时序处理器及时序输入输出控制方法。
技术介绍
在现有的芯片中,如果要实现各种数字接口,就必须在内部加入其控制器。例如要实现SPI接口,就必须加入SPI控制器,要加入UART接口,就必须加入UART控制器,要实现对片外SRAM的读写访问就必须加入SRAM的控制器。然而这些芯片在不同使用者那里的应用场景并不相同。有些客户不需要SPI,但芯片却集成了;而有些客户需要XXX接口,但芯片却没有集成;有些客户需要8路PWM接口,而芯片却只集成了2路。芯片集成了客户不需要的接口,导致性价比下降,不必要的功耗也会增加。而且每设计一种接口会比较复杂,延长了芯片研发生产的周期,也导致成本上升。同时过多接口的加入,导致芯片设计复杂,漏洞过多,出现错误概率增加。
技术实现思路
针对上述现有技术不足,本专利技术提供一种通用输入输出时序处理器。本专利技术提供的一种通用输入输出时序处理器及时序输入输出控制方法是通过以下技术方案实现的:一种通用输入输出时序处理器,由总线接口桥、处理器寄存器堆、时序控制状态机、时序发生计数器、时序RAM存储器、串并转换控制器组成,所述处理器寄存器堆包含多个序列控制寄存器组,其中:所述总线接口桥分别连接处理器寄存器堆、时序RAM存储器,总线接口桥从总线上接收CPU的各种命令传递给各个寄存器,起到了一个命令格式转换的作用;所述处理器寄存器堆连接时序控制状态机,处理器寄存器堆用于暂存处理器的处理数据;所述时序控制状态机连接时序发生计数器,时序控制状态机由取指控制 ...
【技术保护点】
一种通用输入输出时序处理器,其特征在于:由总线接口桥、处理器寄存器堆、时序控制状态机、时序发生计数器、时序RAM存储器、串并转换控制器组成,所述处理器寄存器堆包含多个序列控制寄存器组,其中:所述总线接口桥分别连接处理器寄存器堆、时序RAM存储器,总线接口桥从总线上接收CPU的各种命令传递给各个寄存器,起到了一个命令格式转换的作用;所述处理器寄存器堆连接时序控制状态机,处理器寄存器堆用于暂存处理器的处理数据;所述时序控制状态机连接时序发生计数器,时序控制状态机由取指控制器、译码器、执行器组成,取指器用于读取控制代码,译码器用于分析代码并翻译成执行器便于执行控制的代码,执行器用于配合计数器具体实施控制;所述时序发生计数器连接时序RAM存储器;时序RAM存储器连接串并转换控制器组,时序RAM存储器存储各个序列的控制代码,方便于序列状态机和串并转换控制器的读取,所述串并转换控制器用于完成位宽转换,从时序RAM存储器读取数据,然后依次输送到指定的引脚上。
【技术特征摘要】
1.一种通用输入输出时序处理器,其特征在于:由总线接口桥、处理器寄存器堆、时序控制状态机、时序发生计数器、时序RAM存储器、串并转换控制器组成,所述处理器寄存器堆包含多个序列控制寄存器组,其中:所述总线接口桥分别连接处理器寄存器堆、时序RAM存储器,总线接口桥从总线上接收CPU的各种命令传递给各个寄存器,起到了一个命令格式转换的作用;所述处理器寄存器堆连接时序控制状态机,处理器寄存器堆用于暂存处理器的处理数据;所述时序控制状态机连接时序发生计数器,时序控制状态机由取指控制器、译码器、执行器组成,取指器用于读取控制代码,译码器用于分析代码并翻译成执行器便于执行控制的代码,执行器用于配合计数器具体实施控制;所述时序发生计数器连接时序RAM存储器;时序RAM存储器连接串并转换控制器组,时序RAM存储器存储各个序列的控制代码,方便于序列状态机和串并转换控制器的读取,所述串并转换控制器用于完成位宽转换,从时序RAM存储器读取数据,然后依次输送到指定的引脚上。2.根据权利要求1所述的一种通用输入输出时序处理器,其特征在于:所述序列控制寄存器组中,每个序列控制寄存器组对应1个序列控制。3.根据权利要求1所述的一种通用输入输出时序处理器,其特征在于:所述串并转换控制器是双向的,可从当前设定成输入的引脚上读取数据,写入到存储器的指定位置。4.一种时序输入输出控制方法,其特征在于:采用芯片引脚与RAM交换数据的方式,在控制器的控制下,当设定为输出时,从RAM中读取数据输出到芯片引脚;当设定为输入时,从芯片引脚读取数据写入到RAM中;将一个或多个序列存储在RAM中,当同一时刻只有1个序列在运行或者没有序列在运行;...
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