【技术实现步骤摘要】
本专利技术涉及图像传感器领域,具体涉及包括操作性连接到控制单元的多个像素的图像传感器,所述控制单元包括用于选择地读出多个像素的读出电路。根据本专利技术的图像传感器实现了将多个像素与控制单元简单高效地集成在小的占用区(footprint)中,从而形成紧凑的集成电路架构,并且实现了改进的像素敏感度。而且,本专利技术的图像传感器的独特像素设计使得可以获得具有高的光电导增益、增强的响应度和/或短的响应时间的像素。本专利技术还涉及一种包括所述图像传感器的光电系统,以及一种制造所述图像传感器的方法。
技术介绍
已知在众多应用中使用图像传感器,仅列举一些,所述应用涵盖从普通消费者小配件领域到专业的摄影,以及商业、医疗和/或科学用途。通常的图像传感器包括操作性连接到控制单元的多个像素,每个像素包括光敏元件或者光电探测器,所述控制单元包括读出电路,该读出电路用于选择地读出由入射到多个像素的每个像素的光敏元件上的光产生的光信号。大多数图像传感器采用光电二极管作为它们的像素中的光敏元件。考虑到对于可见光和红外光范围,通常的光电二极管的量子效率不能超过一,这样的图像传感器非常依赖于达到非常低的噪声水平和/或使用长的曝光时间来实现高信噪比。然而,这两种技术都具有重大不足。例如,设计图像传感器电路以实现低噪声需要将前置放大级尽可能地设置在电荷-产生元件(即,光电二极管)附近,如同例如在其中放大器集成在像素内的有源像素传感器中所做的。并且,整体的读出电路的设计变得更复杂。另一方面,增加曝光时间降低了图像传感器的有效的帧速率并且可以导致模糊效应。并且,更长的曝光时间增强了热噪声的不利影 ...
【技术保护点】
一种图像传感器(100,700,725,750,775,900),包括操作性连接到控制单元的多个像素(101,300,402,422,442,600,701,726,751,776),所述控制单元包括选择地读出由入射到所述多个像素的光产生的光信号的读出电路(102),其特征在于:所述图像传感器包括单片三维集成电路(104,302,800),所述单片三维集成电路包括具有多个第一堆叠层的上层(105,604)以及具有多个第二堆叠层的下层(106,605),所述下层置于所述上层的下方;其中,所述多个像素中的每个像素包括:—光敏元件(107,301,403,423,443,500,601,710,727,752,777),所述光敏元件布置在所述上层的选定位置,所述光敏元件包括与传输层(109,304,607)相关联的光敏层(108,303,606),所述传输层包括至少一个二维材料层;—有源装置(110,603),所述有源装置布置在所述下层的选定位置,所述有源装置包括至少一个半导体材料层并且操作性地耦接到所述光敏元件;—第一中间端子(404a,424a,444,703,730,778),所述第一 ...
【技术特征摘要】
2015.06.10 EP 15171314.61.一种图像传感器(100,700,725,750,775,900),包括操作性连接到控制单元的多个像素(101,300,402,422,442,600,701,726,751,776),所述控制单元包括选择地读出由入射到所述多个像素的光产生的光信号的读出电路(102),其特征在于:所述图像传感器包括单片三维集成电路(104,302,800),所述单片三维集成电路包括具有多个第一堆叠层的上层(105,604)以及具有多个第二堆叠层的下层(106,605),所述下层置于所述上层的下方;其中,所述多个像素中的每个像素包括:—光敏元件(107,301,403,423,443,500,601,710,727,752,777),所述光敏元件布置在所述上层的选定位置,所述光敏元件包括与传输层(109,304,607)相关联的光敏层(108,303,606),所述传输层包括至少一个二维材料层;—有源装置(110,603),所述有源装置布置在所述下层的选定位置,所述有源装置包括至少一个半导体材料层并且操作性地耦接到所述光敏元件;—第一中间端子(404a,424a,444,703,730,778),所述第一中间端子电路性连接至所述光敏元件;以及—输出端子(706,732,757,780),所述输出端子电路性连接至所述读出电路(102);其中所述图像传感器还包括暗电流抑制电路(400,420,440),所述暗电流抑制电路被配置成大体上抑制在曝光周期中由所述像素的光敏元件产生的暗电流;并且其中所述控制单元至少部分地布置在所述下层(106,605)并且被配置成,在给定的像素待要被读出时,将所述像素的第一中间端子(404a,424a,444):—通过所述暗电流抑制电路(400,420,440)与所述像素的输出端子(706,732,757,780)电路性连接;或者—与所述像素的输出端子以及与所述暗电流抑制电路电路性连接。2.根据权利要求1所述的图像传感器,其中所述控制单元包括用于使所述多个像素偏置的偏置电路(103);其中所述暗电流抑制电路(400,420)包括至少一个参考元件(401,421,501,502,503,504,602,702,728,753),所述至少一个参考元件具有的暗电导大体上匹配所述像素的光敏元件(403,423,443,500,601,710,727,752)的暗电导;其中所述参考元件/每个参考元件电路性连接到第二中间端子(404b,424b,707,731)和第二偏置端子(406,426)之间,所述第二偏置端子电路性连接至所述偏置电路(103);其中每个像素的光敏元件电路性连接在所述像素的第一中间端子(404a,424a,444,703,730)和设置于所述像素中的第一偏置端子(405,425)之间,每个像素的第一偏置端子电路性连接至所述偏置电路(103);其中所述偏置电路(103)适于在所述多个像素中的像素的光敏元件的第一偏置端子和所述至少一个参考元件的第二偏置端子之间提供偏置电压;以及其中所述控制单元被配置成,在给定的像素待要被读出时,将所述像素的第一中间端子(404a,424a,444,703,730)和所述至少一个参考元件中的参考元件的第二中间端子(404b,424b,707,731)与所述像素的输出端子(706,732,757)电路性连接。3.根据权利要求2所述的图像传感器,其中所述至少一个参考元件中的参考元件(503,504,602)布置在所述上层,并且包括含有至少一个二维材料层的传输层(614)。4.根据权利要求3所述的图像传感器,其中所述参考元件进一步包括与所述参考元件(600)的传输层(614)相关联的光敏层(613)。5.根据权利要求4所述的图像传感器,其中所述参考元件(504,602)进一步包括:置于所述参考元件的光敏层(613)和传输层(614)的上面的第一阻光层(505,615)。6.根据权利要求5所述的图像传感器,其中所述参考元件的光敏层和传输层的下面设置有第二阻光层。7.根据权利要求3至6中任一项所述的图像传感器,其中所述参考元件(602)布置在所述多个像素中的一个像素的光敏元件(601)的下面。8.根据权利要求2至6中任一项所述的图像传感器,其中所述至少一个参考元件中的参考元件布置在所述下层中并且包括可变电阻器(502)。9.根据权利要求1至6中任一项所述的图像传感器,其中所述上层(105,604)包括与所述多个像素的光敏元件(107,301,601)相关联的一个或多个绝缘层(119,307,308,617)。10.根据权利要求9所述的图像传感器,其中所述多个像素中的至少一个像素(300,600)包括:—背栅端子(310),所述背栅端子置于所述至少一个像素的光敏元件(301)的下面,位于布置在所述多个像素的光敏元件(301)的下面的绝缘层(308)和所述单片三维集成电路的下层之间;和/或—顶栅端子(312,612),所述顶栅端子置于所述至少一个像素的所述光敏元件(301,601)的上面。11.根据权利要求1至6中任一项所述的图像传感器,其中所述多个像素中的至少一个像素包括导电互连部(200,210,220,230),以将所述像素的有源装置(110)耦接到所述像素的光敏元件(107),所述导电互连部包括:—竖向接触部(201),所述竖向接触部从所述单片三维集成电路(104)的下层延伸至上层,并且具有第一部分(202),所述第一部分连接到所述像素的有源装置(110),所述第一部分置于所述有源装置的至少一个半导体层上;以及—横向接触部(204,214,224,234),所述横向接触部布置在所述上层上并且与所述竖向接触部的第二部分(203)连接;其中所述横向接触部(204,214,224,234)欧姆性连接到所述像素的光敏元件(107)的传输层(109),并且包括与所述光敏元件(107)的传输层(109)平行的部分(205,225,235)。12.根据权利要求1至6中任一项所述的图像传感器,其中所述多个像素中的每个像素的有源装置(110,603)包括开关(704,705,729,781,782)、放大器(754)、滤波器、数字转换器、电平位移器和/或存储元件(755)。13.根据权利要求1至6中任一项所述的图像传感器,其中所述多个像素被分成集群(s1-s9),每个集群包括一个或多个像素;并且其中每个集群的所述一个或多个像素的光敏元件的光敏层对不同范围的光谱敏感。14.根据权利要求1至6...
【专利技术属性】
技术研发人员:耶拉西莫斯·康斯坦塔投斯,弗兰克·科盆司,斯泰恩·古森斯,胡安·何塞·皮克拉斯,劳尔·皮尔兹,
申请(专利权)人:光子科学研究所,
类型:发明
国别省市:西班牙;ES
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