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本发明提供了一种伪静态存储器，包括第一、第二寄存器组、写操作缓冲器及写操作标志寄存器，比较器，用于比较当前写操作所针对的存储器组地址，与第二寄存器组中的存储器组地址，并输出比较结果信号；控制电路，包括第一控制子模块，用于在当前时钟周期写操作...
该专利属于北京芯技佳易微电子科技有限公司所有，仅供学习研究参考，未经过北京芯技佳易微电子科技有限公司授权不得商用。

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