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一种相位内插(PI)系统,包括:相位内插(PI)级,其被配置成接收第一和第二时钟信号以及多位加权信号,并且产生内插时钟信号,PI级进一步被配置成通过使用所述多位加权信号及其逻辑反相(多位加权_bar信号)来避免上拉/下拉(PUPD)短路情形...该专利属于台湾积体电路制造股份有限公司所有,仅供学习研究参考,未经过台湾积体电路制造股份有限公司授权不得商用。
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一种相位内插(PI)系统,包括:相位内插(PI)级,其被配置成接收第一和第二时钟信号以及多位加权信号,并且产生内插时钟信号,PI级进一步被配置成通过使用所述多位加权信号及其逻辑反相(多位加权_bar信号)来避免上拉/下拉(PUPD)短路情形...