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本发明公开了一种基于FPGA的卷积神经网络IP核设计，基于HLS开发工具对卷积神经网络进行IP核封装，该卷积神经网络IP核包括数据输入，IP核卷积神经网络计算，分类数据输出。本发明提供的IP核从CNN的计算过程以及FPGA的硬件结构出发，采...
该专利属于四川大学所有，仅供学习研究参考，未经过四川大学授权不得商用。

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