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一种用于FPGA的过压输入I/O缓冲器电路，其在输入信号高电平电压与FPGA I/O电源电压相差小于或大于一个P管阈值电压时都可以关住末级驱动P管的源漏极到N阱的PN结，减小过压输入导致的泄露电流，同时还将末级驱动P管的栅极拉高到输入信号高...
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