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本发明提供一种用于可测性设计的时钟网络结构。所述可测性设计的时钟网络结构包括顶层控制单元和模块控制单元，所述顶层控制单元由PLL时钟以及PLL分频时钟对应的时钟控制单元组成，所述模块控制单元由测试模块内部的时钟控制单元组成；所述顶层控制单元...该专利属于中科曙光信息产业成都有限公司;成都海光集成电路设计有限公司所有，仅供学习研究参考，未经过中科曙光信息产业成都有限公司;成都海光集成电路设计有限公司授权不得商用。