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本发明提出了一种细粒度延迟输出控制的电路，其特征在于，包括寄存器组REGISTER、由等延迟延迟注入单元TDO_CELL级联构成的延迟注入单元链、模拟插值电路INTERPLATE以及锁存器LATCH；所述寄存器组REGISTER用于接收数字...
该专利属于深圳市精嘉微电子有限公司所有，仅供学习研究参考，未经过深圳市精嘉微电子有限公司授权不得商用。

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