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本发明公开了一种提高同步逻辑实时运行可靠性的方法，通过规范电路设计，在EDA流程中插入自动化修改网表步骤，在网表中插入冗余电路，提高电路的可靠性，包括原始同步逻辑电路，其特征在于：还包括VOTEs判定逻辑部分，通过组合逻辑部分和时序逻辑部分...
该专利属于深圳市精嘉微电子有限公司所有，仅供学习研究参考，未经过深圳市精嘉微电子有限公司授权不得商用。

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