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本发明提供一种版图边界提取方法及装置，获取集成电路版图中每个矩形子模块的顶点；对集成电路版图中的矩形子模块进行边界提取；将模块与其他未组合的矩形子模块和/或者其他模块进行组合，每组合一次对组合后得到的模块进行边界提取直至组合后的模块为集成电...
该专利属于中国科学院微电子研究所所有，仅供学习研究参考，未经过中国科学院微电子研究所授权不得商用。

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