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本发明提出一种可重构处理器及可重构处理器的时序控制方法。该可重构处理器包括可重构单元阵列RCA和控制单元，RCA包括多个可重构单元RC；控制单元，用于生成并向RCA发送时序控制信息；RCA，用于根据时序控制信息执行运算任务，RCA中的RC接...
该专利属于清华大学所有，仅供学习研究参考，未经过清华大学授权不得商用。

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