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本发明公开了一种基于FPGA的潜在目标排序方法，其具体步骤为：搭建包括输入控制模块、并行比较模块、脉动排序模块和输出控制模块的基于FPGA的潜在目标排序系统；输入控制模块实现对待排序数据集个数N的配置和待排序数据缓存；并行比较模块并行比较待...
该专利属于北京电子工程总体研究所所有，仅供学习研究参考，未经过北京电子工程总体研究所授权不得商用。

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