【技术实现步骤摘要】
【国外来华专利技术】
本公开总体上涉及数据通信系统，并且更具体地涉及低功率应用中的高速信号传输。
技术介绍
均步时钟信号经常用于为同步存储器系统中的信号传输操作定时。通过使用相同的时钟源来提供存储器控制器和存储器设备两者中的发射/接收定时，避免了频率漂移， 从而产生相对简单、鲁棒的定时布置。然而，由于时钟参考分发在控制器与存储器之间的空间中，因此两个芯片的时钟域彼此之间通常具有任意的相位偏移，必须对该相位偏移进行补偿以支持同步通信。复杂的问题是，在很大程度上归因于在每个芯片中所提供的用于向各种发射和接收电路扇出时钟的时钟缓冲电路，芯片间的相位偏移易于随温度和电压而大幅漂移。许多现代存储器系统通过发射选通脉冲或其他源同步定时信号来管理芯片间的相位漂移，以控制接收设备内的数据采样，从而有效地将发射设备的时钟域延伸至接收设备。遗憾地是，由于通常需要附加的信号驱动器、管脚和精确路由的信号线(用于匹配选通脉冲与数据线之间的传播时间)，因此该方法遭受相当大的功率/成本惩罚。另一方法是通过在存储器控制器和每个存储器设备内提供锁相环(PLL)或延迟锁定环(DLL)来补偿漂移的相位偏移，以在参考时钟与...
【技术保护点】
１．一种集成电路存储器设备，包括：时钟输入，用于从外部源接收第一时钟信号；信号传输电路，用于响应于所述第一时钟信号的转变从所述集成电路存储器设备输出数据信号，其中所述第一时钟信号包括针对以所述数据信号传达的数据的每个位的相应转变；时钟生成电路，用于响应于所述第一时钟信号的转变生成第二时钟信号，所述第二时钟信号在所述第一时钟信号的每Ｎ个周期循环一次，Ｎ为大于１的整数，所述时钟生成电路包括相位调节电路用于使所述第二时钟信号的相位能够相对于所述第一时钟信号的相位进行调节。
【技术特征摘要】
【国外来华专利技术】...
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