基于64b/66b编码的串行级联系统技术方案

本发明专利技术提供一种基于64b/66b编码的串行级联系统，由各个子阵节点和主控芯片通过级联构成闭合通信环路，在环路上以64b/66b编码的数据块形式通过串行接口进行数据传输，每个芯片节点在通信环路中接收上一节点传输的数据块，通过同步头位识别并解析同步字，进而决定在本地处理或转发数据块至下一节点。本发明专利技术定义并使用级联式结构，在标准串行接口中实现了对多达128个子阵通道的同时通信。这种设计设计不仅让主控芯片能够通过一对串行接口与众多子阵进行通信，有效地解决了高速串行通道数量有限的问题，还因为减少了对配备多个串行通道的主控芯片的需求，从而显著降低了整个系统的成本。

【技术实现步骤摘要】

本专利技术涉及数据传输，特别是涉及一种基于64b/66b编码的串行级联系统。

技术介绍

1、随着相控阵雷达技术的发展，雷达通道数量显著增加，这些通道数量的增加提高了雷达的反应速率、多目标追踪能力、分辨率、多功能性和电子反对抗能力。但是由于传统的主控芯片接口数量有限，无法直接连接到每一个阵列节点。为了解决上述问题，大部分多通道相控阵雷达采用子阵方案来拓展阵列节点，但使用子阵方案会使得各子阵内部节点无法直接连接至主控芯片，只能通过子阵控制模块向主控芯片传递数据。同时由于子阵数量的增加，对主控芯片高速串行通道数量的需求也随之增加，主控芯片的高速串行通道数量成为瓶颈，限制了系统的性能和扩展能力。使用具有多个串行通道的主控芯片可以缓解这一困难，但是会使得系统成本显著增加。

技术实现思路

1、鉴于以上所述现有技术的缺点，本专利技术的目的在于提供一种基于64b/66b编码的串行级联系统，用于解决现有方案针对子阵增多导致主控芯片高速串行通道成为瓶颈的情况，增加通道数则显著提升系统成本的技术问题。

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【技术保护点】

1.一种基于64b/66b编码的串行级联系统，其特征在于，包括：多个子阵节点以及主控芯片；

2.根据权利要求1中所述的基于64b/66b编码的串行级联系统，其特征在于，每个芯片节点通过内部设置的应用物理层的串行收发器，与通信环路中与其邻接的芯片节点进行通信；其中，串行收发器包括：

3.根据权利要求2中所述的基于64b/66b编码的串行级联系统，其特征在于，所述级联控制器用于识别每个数据块的同步头并利用连续接收的32个数据块的同步头生成每个多块的同步字；基于每个多块的同步字进行校验以及地址提取，确定各多块的处理方式，并生成对应的处理控制指令。p>

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【技术特征摘要】

1.一种基于64b/66b编码的串行级联系统，其特征在于，包括：多个子阵节点以及主控芯片；

2.根据权利要求1中所述的基于64b/66b编码的串行级联系统，其特征在于，每个芯片节点通过内部设置的应用物理层的串行收发器，与通信环路中与其邻接的芯片节点进行通信；其中，串行收发器包括：

3.根据权利要求2中所述的基于64b/66b编码的串行级联系统，其特征在于，所述级联控制器用于识别每个数据块的同步头并利用连续接收的32个数据块的同步头生成每个多块的同步字；基于每个多块的同步字进行校验以及地址提取，确定各多块的处理方式，并生成对应的处理控制指令。

4.根据权利要求3中所述的基于64b/66b编码的串行级联系统，其特征在于，识别每个数据块的同步头包括：每检测到64个连续以66位间隔进行的位转换，则锁定一个数据块的同步头位。

5.根据权利要求3中所述的基于64b/66b编码的串行级联系统，其特征在于，利用连续接收的32个数据块的同步头生成每个多块的同步字包括：将连续32个数据块的同步头位分别转换为二进制的转换位值，并将32个转换位值按接收顺序进行排列构成32位同步字；

6.根据权利要求5中所述的基于64b/66b编码的串行级联系统，其特征在于，12位的cr...

【专利技术属性】
技术研发人员：杨宇峰，潘颖达，徐栋，王志宇，
申请(专利权)人：浙江大学，
类型：发明
国别省市：