接口传输装置与方法制造方法及图纸

技术编号:4192094 阅读:137 留言:0更新日期:2012-04-11 18:40
一种接口传输装置与方法,该接口装置位于第一装置内,且该接口装置包含:传输接口用以接收初始化信号及接口信号;接收电路通过传输接口接收初始化信号,并依据初始化信号获得接口信号的位长度,第一装置依据位长度解析接口信号。

【技术实现步骤摘要】

本专利技术涉及一种,特别是一种使用单一传输线的接 口传输装置与方法。
技术介绍
请参照图1,该图所示为已知传输接口的示意图,包含控制端AIO、 设备端A20及传输接口 A30。在此所指的控制端A10可为液晶显示装置中的^:控制单元(Micro Controller Unit, MCU),而设备端A20可为液晶显示装置中的缩放控制芯 片(Scaler IC)。由图1所示可知,已知技术中控制端AIO与设备端A20之 间通过三根接脚(pin),亦即须利用三条传输线配合传输接口 A30来完成数 据的传输。其中,三根接脚分别为SCSB、 SCLK与SDIO。上述三根接脚中SCSB用以传输控制信号,亦即传输使能信号(enable signal),并藉由SCSB接脚可控制传输接口 A30的运作。SCLK接脚用以载送 取样频率(sample clock),而SDIO用以载送地址与凝:据(address/data)。随着电子产品日益朝向轻薄短小的发展趋势,电子产品中的集成电路 (IC)也不断力求其体积的缩小化。然而,已知传输4妄口,在控制端A10与设 备端A20之间乃利用多根接脚(SCSB、 SCLK与SDIO)来完成地址/数据的传送 及接收。因此,占用IC的接脚数过多,容易造成IC在体积缩小化上的一个 瓶颈。因此,如何减少传输接口的接脚数量,以利IC体积的缩小化,为一亟 待解决的问题。
技术实现思路
有鉴于此,本专利技术提出一种。利用l位的串行通讯 接口,亦即仅利用单一条传输线,即可完成已知技术的传送与接收的动作。 如此,将可大幅减少接脚的数量,不仅可节省接脚成本的支出,更有利于IC体积的缩小化。本专利技术提出一种接口装置,位于第一装置内,该接口电路包含传输接口用以接收初始化信号及接口信号;接收电路通过传l!H妾口接收初始化信 号,并依据初始化信号以获得接口信号的位长度,第一装置依据位长度以解 析接口信号。本专利技术亦提出一种接口装置,位于第一装置内,该4妻口电路包含传送 电路用以依据位长度以产生初始化信号,以及依据位长度以产生接口信号, 其中,初始化信号用以代表位长度,接口信号须依据位长度以解析出接口信 号的信息;传输接口用以接收来自传送电路的初始化信号及接口信号,并传 送出初始化信号及接口信号。本专利技术亦提出一种应用于传输界面的传输方法,该方法包含下列步骤 通过传输接口以接收初始化信号及接口信号;依据初始化信号以获得接口信 号的位长度;依据位长度以解析接口信号以获得接口信号的信息。本专利技术亦提出一种应用于传输界面的传输方法,该方法包含依据位长 度以产生初始化信号,其中,初始化信号用以代表位长度;依据位长度以产 生接口信号,其中,接口信号须依据位长度以解析出接口信号的信息;通过 传输接口传送出初始化信号及接口信号。有关本专利技术的较佳实施例及其功效,兹配合图式说明如后。附图说明图l是已知传输接口的示意图2是本专利技术的接口传输装置的一实施例示意图3是本专利技术的接口传输装置中的初始模块的一 实施例示意图; 图4是本专利技术的接口传输装置的重置/自动学习的时序图5 A是本专利技术的接口传输装置的接口传输的 一 实施例的数据时序图5B是本专利技术的接口传输装置的接口传输的另 一实施例的数据时序图6是本专利技术的接口传输方法的流程图7是本专利技术的接口传输方法的另一流程图。主要组件符号说明<table>table see original document page 7</column></row><table>具体实施例方式请参照图2,该图所示为接口传输装置的一实施例示意图。本专利技术的接 口传输装置,用以在主(master)模块30与从(slave)模块40之间传送与接 收传输信息,而接口传输装置l包含传输线IO、初始模块20。传输线10用以连接主模块30与从模块4 0。本专利技术所提出的接口传输装 置1在主模块30与从模块40之间只须具备单一条传输线10,因此只占用一 根接脚,较已知技术中使用三根接脚的例子,节省了两根接脚。其中,本发 明所使用的单 一 根接脚可称的为通用输入输出(general purpose i叩ut/output, GPIO)接脚。初始模块20通过传输线10,接收由主模块30所传送的位周期(bit period),而位周期决定传输信息的位长度。由于本专利技术的接口传输装置1 只具备一条传输线IO,不像已知技术中具有三根接脚的例子,具有一条专门 载送取样频率(sample clock)的传输线(SCLK)。因此,本专利技术在传送接收传 输信息之前,必须先定义位周期,而该位周期由主^t块30所产生,通过传 输线IO传送给从模块40,再由从模块40记忆该位周期。其中,该位周期可 用以决定传输信息的位长度,亦即可通过位周期来决定位长度,而先定义出 主模块30与从模块40之间的传输信息的每一个位的长度大小。之后,便可 依据位长度于主模块30与从模块40之间来收发传输信息。其中,主模块30 可为微控制单元,而从模块40可为缩放控制芯片。接下来为了配合本专利技术的接口传输装置l,提出针对主模块30与从模块40间使用单一条传输线10的传输协议(protocol)。首先,请先参照图3为接口传输装置中的初始模块20的一实施例示意 图。初始^^莫块20包含有量测单元201、重置单元203、状态机205、内部缓 存器存取控制单元207及输出控制单元209。重置单元203用以侦测是否有接收到重置信号或中断信号,以决定是否 于中断结束后发出重设信号来重新设定接口传输装置1。量测单元201用以 接收位周期,并加以量测位周期中每一位的频率数,以产生位频率信号。状 态机205接收传输信息、重置信号及位频率信号,用以决定初始模块20的 状态,并产生状态信号与控制信号。其中,控制信号中包括有读取控制信号、 写入控制信号、地址、输入数据及状态信号。内部1£存器存取控制单元207 用以接收控制信号,并产生内部緩存器控制信号来存取从模块30中的緩存 器,且依据内部緩存器控制信号输出输出数据。输出控制单元209用以接收 状态信号及输出数据,并依据状态信号来决定输出信号的输出与否。此外, 4刀始才莫块20可采用石更4牛4苗述+吾言(Hardware Description Language, HDL), 如Verilog, VHDL等,直接以功能性的描述方式来撰写初始模块20的行为 (behavior),然后再通过电路合成工具予以合成(synthesis ),即可得到 所需的电路。请参照图4为重置/自动学习(reset/ auto learning)的时序图。首先, 在初始模块20接收位周期前,先接收由主模块30所传送的重置(reset)信 号50。顾名思义,重置信号50的用途为重新设定接口传输装置1,以便后 续可用以接收位周期。由图4所示可知,重置信号50可为低电平(low)信号, 此外为了避免重置信号50的时间过短,而造成重置动作尚未完成时,重置 信号50便已结束的错误情形产生。因此,本专利技术建议重置信号50至少须具 有4096个频率长度,但不以此为限。经由重置信号50而完成重置动作后,接着便会^t妾收由主模块30所传送 的位周期。请续参照图4,紧接本文档来自技高网...

【技术保护点】
一种接口装置,位于第一装置内,该接口电路包含: 传输接口,用以接收初始化信号以及接口信号;及 接收电路,通过该传输接口接收该初始化信号,并依据该初始化信号获得该接口信号的位长度,该第一装置依据该位长度解析该接口信号。

【技术特征摘要】
1.一种接口装置,位于第一装置内,该接口电路包含传输接口,用以接收初始化信号以及接口信号;及接收电路,通过该传输接口接收该初始化信号,并依据该初始化信号获得该接口信号的位长度,该第一装置依据该位长度解析该接口信号。2. 如权利要求1所述的接口装置,其中该接收电i 各在接收该初始化信号 前,先通过该传输接口接收重置信号。3. 如权利要求1所述的接口装置,其中该初始化信号包含交互的高电平 信号与低电平信号。4. 如权利要求3所述的接口装置,其中该接收电路包含量测单元,接收该初始化信号,并依据该初始化信号中所包含交互的高 电平信号与低电平信号,决定该接口信号的l位的长度。5. 如权利要求1所述的接口装置,其中当该接收电^^妄收该初始化信号 后,则该第 一装置经由该传输接口传送出与该初始化信号实质上相同的信6. 如权利要求1所述的接口装置,其中该接口信号还包含地址信息及写 入/读取信息。7. 如权利要求1所述的接口装置,其中该传输接口为通过传输线来接收 l位信号。8. —种接口装置,位于第一装置内,该接口电路包含传送电路,用以依据位长度产生初始化信号,以及依据该位长度产生接 口信号,其中,该初始化信号用以代表该位长度,该^接口信号须依据该位长 度解析出该接口信号的信息;及传输接口 ,用以接收来自该传送电路的该初始化信号以及该接口信号, 并传送出该初始化信号以及该接口信号。9. 如权利要求8所述的接口装置,其中该传送电路在传送该初始化信号 前,先通过该传输接口传送出重置信号。10. 如权利要求8所述的接口装置,其中该初始化信号包含交互的高电 平信号与低电平信号。11. 如权利要求8所述的接口装置,其中当该传送电路传送该初始化信号后,则该第 一装置经由该传输接口接收到与该初始化信号实质上相...

【专利技术属性】
技术研发人员:龚文侠吴文哲易信宏
申请(专利权)人:瑞昱半导体股份有限公司
类型:发明
国别省市:71[中国|台湾]

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