【技术实现步骤摘要】
本专利技术涉及一种并行相关器以及使用该相关器实现GPS信号的并行捕获方法。
技术介绍
并行相关器是GPS接收机基带处理电路的关键电路部分,可用于处理从射 频端产生的数字信号,并对信号中的数据进行相关运算,然后将运算结果通过 并行端口输出。伪码的捕获方法主要有以下三种1、 串行捕获法。即把GPS信号与本地产生的伪码在时间间隔内依次进行相 关运算。串行捕获法电路结构简单,但是捕获时间长。2、 并行捕获法。即同时设置多个相关器,每个相关器的本地伪码相位相差 一定的时间。并行捕获法的捕获时间短,但电路较为复杂。3、 串/并捕获法。即GPS信号与多个不同相位的本地伪码进行相关运算, 判断逻辑一次分别对这多个结果进行判决。串/并捕获法在电路复杂度和捕获时 间之间进行了折衷。
技术实现思路
本专利技术目的是提供一种GPS信号的并行捕获系统及方法,其解决了现有的 捕获系统和方法电路复杂、捕获时间长的技术问题。 本专利技术的技术解决方案是一种GPS信号的并行捕获系统,包括GPS信号接收电路3、伪码产生电路9、 乘法电路8、滤波电路4、阈值比较电路6和同步跟踪电路7;特殊之处是,所 述 ...
【技术保护点】
一种GPS信号的并行捕获系统,包括GPS信号接收电路(3)、伪码产生电路(9)、乘法电路(8)、滤波电路(4)、阈值比较电路(6)和同步跟踪电路(7);其特征在于:所述并行捕获系统还包括多模计数电路(2)、选择电路(1)和数据存储电路(5),所述伪码产生电路(9)包括至少两个伪码产生器(91);所述数据存储电路(5)包括与伪码产生器(91)数量一致的多个数据存储器(51);所述多个伪码产生器(91)与选择电路(1)连接,所述多模计数电路(2)的输入接标准时钟信号(f0),其输出与选择电路(1)的控制端相连;所述选择电路(1)和GPS信号接收电路(3)的输出分别与乘法电路(8 ...
【技术特征摘要】
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