【技术实现步骤摘要】
【国外来华专利技术】包括耦合到虚设栅极接触件的晶体管的集成器件
[0001]其他申请的交叉引用
[0002]本专利申请要求于2020年3月24日提交的专利技术名称为“INTEGRATED DEVICE COMPRISING TRANSISTOR COUPLED TO A DUMMY GATE CONTACT”并且转让给其受让人的非临时申请No.16/828,487的优先权,并且据此通过引用将其明确并入本文。
[0003]各种特征涉及晶体管,但是更具体而言,涉及一种包括耦合到虚设栅极接触件的晶体管的集成器件。
技术介绍
[0004]图1示出了平面场效应晶体管(FET)100。FET 100形成在衬底102和氧化物104之上(over)。FET 100包括源极106、漏极108和栅极110。源极106和漏极108位于衬底102之上。在最小电压被施加在栅极110和衬底102之间时,电流可以在源极106和漏极108之间流动。一直存在提高晶体管性能的需求,例如,当电流在晶体管的源极和漏极之间流动时能够更好地进行控制。
技术实现思路
[0005]各种特征涉及晶体管,但是更具体而言,涉及一种包括耦合到虚设栅极接触件的晶体管的集成器件。
[0006]一个示例提供了一种集成器件,该集成器件包括衬底以及位于衬底之上的第一晶体管,其中第一晶体管包括栅极。该集成器件包括耦合到第一晶体管的栅极的第一栅极接触件,其中第一栅极接触件被配置为电耦合到集成器件的互连件。该集成器件包括耦合到栅极的第二栅极接触件,其中第二栅极接触件仅 ...
【技术保护点】
【技术特征摘要】
【国外来华专利技术】1.一种集成器件,包括:衬底;第一晶体管,位于所述衬底之上,其中所述第一晶体管包括栅极;第一栅极接触件,耦合到所述第一晶体管的所述栅极,其中所述第一栅极接触件被配置为电耦合到所述集成器件的互连件;以及第二栅极接触件,耦合到所述栅极,其中所述第二栅极接触件仅直接电耦合到所述栅极。2.根据权利要求1所述的集成器件,还包括位于所述衬底之上的第二晶体管,其中所述第二晶体管包括所述栅极。3.根据权利要求2所述的集成器件,其中所述第二栅极接触件被配置为调节在所述第一晶体管中引发第一电流并且在所述第二晶体管中引发第二电流所需的阈值电压。4.根据权利要求3所述的集成器件,其中所述第一晶体管包括p沟道场效应晶体管(PFET),并且所述第二晶体管包括n沟道场效应晶体管(NFET)。5.根据权利要求3所述的集成器件,其中所述第一晶体管包括n沟道场效应晶体管(NFET),并且所述第二晶体管包括p沟道场效应晶体管(PFET)。6.根据权利要求3所述的集成器件,其中所述第一晶体管包括第一鳍状物和第二鳍状物。7.根据权利要求6所述的集成器件,其中所述第一栅极接触件位于包括所述第一鳍状物和所述第二鳍状物的区域之上。8.根据权利要求7所述的集成器件,其中所述第二栅极接触件位于包括所述第一鳍状物和所述第二鳍状物的所述区域之上。9.根据权利要求7所述的集成器件,其中所述第一晶体管包括p沟道场效应晶体管(PFET)。10.根据权利要求7所述的集成器件,其中所述第一晶体管包括n沟道场效应晶体管(NFET)。11.根据权利要求1所述的集成器件,其中所述第二栅极接触件是虚设栅极接触件。12.根据权利要求1所述的集成器件,还包括位于所述衬底之上的第二晶体管,其中所述第二晶体管也包括所述栅极,其中所述第一晶体管是p沟道场效应晶体管(PFET),其中所述第二晶体管是n沟道场效应晶体管(NFET),并且其中所述第二栅极接触件位于所述第一晶体管之上。13.根据权利要求1所述的集成器件,还包括位于所述衬底之上的第二晶体管,其中所述第二晶体管也包括所述栅极,其中所述第一晶体管是p沟道场效应晶体管(PFET),其中所述第二晶体管是n沟道场效应晶体管(NFET),并且其中所述第二栅极接触件位于所述第二晶体管之上。14.根据权利要求1所述的集成器件,还包括位于所述衬底之上的第二晶体管,其中所述第二晶体管也包括所述栅极,其中所述第一晶体管是n沟道场效应晶体管(NFET),并且
其中所述第二晶体管是p沟道场效应晶体管(PFET)。15.根据权利要求14所述的集成器件,其中所述第二栅极接触件位于所述第一晶体管或所述第二晶体管之上。16.根据权利要求1所述的集成器件,其中所述第一晶体管包括平面晶体管、场效应晶体管(FET)或栅极全环绕(GAA)FET。17.根据权利要求1所述的集成器件,其中所述集成器件被并入到设备中,所述设备选自包括以下各项的组:音乐播放器、视频播放器、娱乐单元、导航设备、通信设备、移动设备、移动电话、智能电话、个人数字助理、固定位置终端、平板计算机、计算机、可穿戴设备、膝上型计算机、服务器、和机动车辆中的设备。18.一种装置,包括:衬底;第一晶体管,位于所述衬底之上,其中所...
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