一种内存写入延迟时间的决定方法,用于一计算机系统,所述计算机系统包括一北桥、一内存及一基本输入输出系统,所述内存与所述北桥电性连接,其特征在于:该方法包括如下步骤: 由所述北桥决定一写入延迟时间; 由所述北桥对所述内存发出一写入指令以写入一样本; 在该写入延迟时间后,依据所述写入指令写入所述样本至所述内存; 由所述基本输入输出系统执行读取所述内存储存的样本;以及, 由所述基本输入输出系统执行检查读取的样本是否符合写入的所述样本,若是,则该写入延迟时间为合格。(*该技术在2023年保护过期,可自由使用*)
【技术实现步骤摘要】
本专利技术涉及一种计算机系统内存写入延迟时间的决定方法及其装置,特别是涉及一种动态随机存取内存写入延迟时间的调整方法及其装置。
技术介绍
一般的电子产品,例如是计算机,内部都设置有动态随机存取内存(Dynamic Random Access Memory,DRAM),以供处理器暂存数据、程序等。动态随机存取内存越大,计算机运行越顺畅。因此现今计算机主机板上都设置有多个可以插入动态随机存取内存的内存插槽,以供使用者可以视需要而方便地扩充。动态随机存取内存,例如是双倍数据速率(Double Data Rate,DDR)动态随机存取内存。当处理器下达写入命令给内存后,内存需要一段延迟时间才会实际写入内存,以确保数据的正确性。而由于制造厂商的不同,写入每条内存所需的延迟时间也不相同。因此计算机在启动时,需要确认内存的写入延迟时间,以确保读写的正确性。图1是内存的写入延迟时间示意图。当写入指令W发出后,内存有最小写入延迟时间tDQSSm,也就是最少要等待这个时间,数据到达信号(Datastrobe)DQS才能转变为高位电平,以将数据写入内存。内存另有最大缓冲时间tDQSSM,也就是在这个时间之前,数据到达信号(data strobe)DQS需转变为高位电平,以将数据写入内存。因此只要写入延迟时间在最小缓冲时间tDQSSm及最大缓冲时间tDQSSM之间,内存所写入的数据就可以保证是正确的。一条内存的两面都可以有内存芯片,内存的一面,称做一列(rank)内存,是由一个芯片选择信号(chip select,CS)所启动。例如是有四条内存的计算机,每条内存的两面都有记忆芯片,则此计算机有8列(rank)内存。计算机在启动时,需针对此8列内存分别检查写入延迟时间的范围,最后再决定该8列内存可以共享的写入延迟时间。图2是传统的内存写入延迟时间的检查方法流程图。首先,发出写入命令给内存,如步骤210所示。等待一段写入延迟时间,如步骤220所示。然后内存才依据写入命令将一组样本写入,如步骤230所示。一组样本例如是。接着,从内存将样本读出,如步骤240所示。然后,检查所读出的样本是否正确,如步骤250所示。若是,则表示此写入延迟时间为合格,如步骤260所示;若否,则表示此写入延迟时间为不合格,如步骤270所示。在步骤280中,改变写入延迟时间,再回到步骤210重新检查此改变后的写入延迟时间是否合格。一般可以将写入延迟时间由小到大去测试,以找出此内存的最小写入延迟时间tDQSSm与最大写入延迟时间tDQSSM。计算机中的各列内存依照图2所示的方法找出其最小写入延迟时间tDQSSm与最大写入延迟时间tDQSSM。则共享的最小写入延迟时间即为各最小写入延迟时间的最大值,共享的最大写入延迟时间即为各最大写入延迟时间的最小值。然后在此共享的最小写入延迟时间与此共享的最大写入延迟时间中找出一个共享写入延迟时间tDQSS,往后计算机运行时,内存即可以使用该共享写入延迟时间tDQSS而写入数据,这样就可以确保写入的数据是为正确的。然而,上述的检查方法所耗费的时间过长。一般执行上述的检查方法由计算机中的基本输出入系统(Basic Input/Output System,BIOS)所执行。基本输出入系统位于电连接于南桥的一个只读存储器芯片(ROM)上。中央处理器从只读存储器芯片上读取指令不够快,而且基本输出入系统还要从内存读出样本来确认,因此整个写入延迟时间的检查流程会很慢,造成计算机开机所需的时间太久。
技术实现思路
本专利技术所要解决的技术问题是提供一种增快内存写入延迟时间决定速度的决定方法及其装置,以缩短整个写入延迟时间的检查时间,从而缩短计算机开机等待时间。为了实现上述目的,本专利技术提出一种内存写入延迟时间的决定装置,包括中央处理器、内存北桥、南桥及基本输入输出系统(BIOS),北桥分别与中央处理器及内存电性连接,以不同的写入延迟时间将一样本填入内存,基本输入输出系统读取内存储存的样本,并检查读取的样本正确性以决定写入延迟时间。为了更好地实现上述目的,本专利技术还提出一种内存写入延迟时间的决定方法,包括以下步骤首先,由北桥决定一写入延迟时间;接着,北桥对内存下一写入指令以写入一样本;接着,内存在等待写入延迟时间后,依据写入指令写入样本;然后,由基本输入输出系统(BIOS)读取内存储存的样本并检查其正确性以决定写入延迟时间。为了更好地说明本专利技术的上述目的、特征和优点,下文特举一较佳实施例,并配合附图详细说明如下附图说明图1是内存的写入延迟时间示意图。图2是传统的内存写入延迟时间的检查方法流程图。图3是依照本专利技术一较佳实施例的一种计算机系统方块图。图4A是计算机系统所使用的一种内存写入延迟时间的决定方法流程图。图4B是图4A中步骤410,北桥写入内存的方法流程图。图5为内存的示意图。其中,附图标记明310-中央处理器,320-北桥,330-南桥,340-内存,350-基本输入输出系统(BIOS)具体实施方式计算机刚启动时,需初始化各种硬件,此动作由计算机中的基本输出入系统(Basic Input/Output System,BIOS)来执行的。该内存的初始化任务之一就是要决定其写入延迟时间。计算机中可能会同时存在好几条不同厂商制造的内存,每条内存的特性不会相同,因此需要找到一个每条内存都可以接受的写入延迟时间,以确保数据存取的正确性。传统上的决定内存写入延迟时间的检查方法是由计算机中的基本输出入系统(BIOS)所执行。该基本输出入系统是位于电连接于南桥的一个只读存储器芯片(ROM)上,其与对外的输出/入速度很慢。中央处理器从只读存储器芯片上读取指令不够快,而且基本输出入系统还要从内存读出样本来确认,因此整个写入延迟时间的检查流程会很慢,造成计算机开机所需的时间太久。本专利技术即是使用与内存电性连接的北桥负担部分的写入延迟时间的检查工作,以加快写入延迟时间的检查时间。图3是依照本专利技术一较佳实施例的一种计算机系统组成方块图。该计算机系统300包括中央处理器310、北桥320、南桥330、内存340及基本输出入系统(BIOS)350。内存340与北桥320电性连接,中央处理器310通过北桥320而存取内存340。基本输入输出系统(BIOS)350是通过南桥330与北桥320而存取内存。与传统计算机系统不同的是,北桥320负担了计算机初始时检查内存的写入延迟时间的工作,将详细说明于后。图4A是计算机系统所使用的一种内存写入延迟时间的决定方法流程图。首先,在步骤410中,由北桥320以不同的写入延迟时间将样本填至内存340。请同时参照图5,其为内存340的示意图。写入延迟时间一般有OxO-OxFF的值,北桥320与内存340一次传送的数据是64字节(byte),因此本实施例将内存340规划为区块D、D、…、D,一个区块为64字节。该区块是分别对应储存写入延迟时间为0、1、…、n的样本。北桥320开始以写入延迟时间为0将样本填入内存340的区块D;然后以写入延迟时间为1将样本填入内存340的区块D;依此类推,最后以写入延迟时间为n将样本填入内存340的区块D。由于北桥320对内存340的写入速度很快,因此本步骤很快即可完成。在步骤430中,由基本输入输出系统本文档来自技高网...
【技术保护点】
【技术特征摘要】
【专利技术属性】
技术研发人员:朱修明,
申请(专利权)人:威盛电子股份有限公司,
类型:发明
国别省市:
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