The invention discloses a driving circuit, a display panel and a display device. The driving circuit consists of several cascaded shift registers, which include the pull-up control unit, the pull-down control unit, the pull-up output unit, the pull-down output unit and the output terminal of the shift register. The pull-up control unit is electrically connected with the pull-up output unit and outputs the second signal to the output terminal of the shift register. The pull-down control unit is electrically connected with the pull-down output unit and is electrically connected to the shift register. The output end of the device outputs the third signal, the control end of the pull-down control unit inputs the second clock signal, and the first end of the pull-down control unit connects to the control of the pull-down control unit; in the working stage, the control end of the pull-up output unit receives the effective level; in the reset stage, the control end of the pull-down output unit receives the effective level, and the second clock signal only provides the effective power in the reset stage. Ping. The invention can ensure the stability of the circuit and avoid disorderly display of the display panel.
【技术实现步骤摘要】
驱动电路、显示面板及显示装置
本专利技术涉及显示
,更具体地,涉及一种驱动电路、显示面板及显示装置。
技术介绍
现有的显示装置技术中,显示面板主要分为液晶显示面板和有机自发光显示面板两种主流的技术。其中,液晶显示面板通过在像素电极和公共电极上施加电压,形成能够控制液晶分子偏转的电场,进而控制光线的透过实现显示面板的显示功能;有机自发光显示面板采用有机电致发光材料,当有电流通过有机电致发光材料时,发光材料就会发光,进而实现了显示面板的显示功能。显示面板中驱动电路是实现显示面板像素驱动重要电路,现有的驱动电路中通常包括多个控制端和信号输入端,通过对各个控制端和信号输入端输入信号的时序进行控制,保证驱动电路的输出端在相应的时间段输出相应的信号。以扫描驱动电路为例,在一帧画面的扫描过程中,在一个移位寄存器中需要保证移位寄存器的输出端在某一个时间段(t1′)内输出有效电平信号,而在其他时间段(t2′)内都输出无效电平信号,而如果在t1′输出了无效电平信号,将导致显示面板出现乱显。因此,提供一种电路稳定性好的驱动电路、显示面板及显示装置,避免显示面板出现乱显现象时本领域亟待解决的问题。
技术实现思路
有鉴于此,本专利技术提供了一种驱动电路、显示面板及显示装置,解决了提高电路稳定性,免显示面板出现乱显的问题。第一方面,本专利技术提供一种驱动电路,包括多个级联的移位寄存器,移位寄存器包括上拉控制单元、下拉控制单元、上拉输出单元、下拉输出单元和移位寄存器输出端,其中,上拉控制单元,与上拉输出单元电连接,上拉控制单元的控制端输入第一时钟信号,上拉控制单元的第一端输入第一信号 ...
【技术保护点】
1.一种驱动电路,其特征在于,包括多个级联的移位寄存器,所述移位寄存器包括上拉控制单元、下拉控制单元、上拉输出单元、下拉输出单元和移位寄存器输出端,其中,所述上拉控制单元,与所述上拉输出单元电连接,所述上拉控制单元的控制端输入第一时钟信号,所述上拉控制单元的第一端输入第一信号,所述上拉控制单元的第二端电连接所述上拉输出单元的控制端;所述下拉控制单元,与所述下拉输出单元电连接,所述下拉控制单元的控制端输入第二时钟信号,所述下拉控制单元的第一端连接到所述下拉控制单元的控制端,所述下拉控制单元的第二端电连接所述下拉输出单元的控制端;所述上拉输出单元的第一端输入第二信号,所述上拉输出单元的第二端连接到所述移位寄存器输出端,所述上拉输出单元的控制端接收有效电平后,向所述移位寄存器输出端输出所述第二信号;所述下拉输出单元的第一端输入第三信号,所述下拉输出单元的第二端连接到所述移位寄存器输出端,所述下拉输出单元的控制端接收有效电平后,向所述移位寄存器输出端输出所述第三信号;在工作阶段,所述上拉输出单元的控制端接收有效电平;在复位阶段,所述下拉输出单元的控制端接收有效电平,所述第二时钟信号仅在复位阶段 ...
【技术特征摘要】
1.一种驱动电路,其特征在于,包括多个级联的移位寄存器,所述移位寄存器包括上拉控制单元、下拉控制单元、上拉输出单元、下拉输出单元和移位寄存器输出端,其中,所述上拉控制单元,与所述上拉输出单元电连接,所述上拉控制单元的控制端输入第一时钟信号,所述上拉控制单元的第一端输入第一信号,所述上拉控制单元的第二端电连接所述上拉输出单元的控制端;所述下拉控制单元,与所述下拉输出单元电连接,所述下拉控制单元的控制端输入第二时钟信号,所述下拉控制单元的第一端连接到所述下拉控制单元的控制端,所述下拉控制单元的第二端电连接所述下拉输出单元的控制端;所述上拉输出单元的第一端输入第二信号,所述上拉输出单元的第二端连接到所述移位寄存器输出端,所述上拉输出单元的控制端接收有效电平后,向所述移位寄存器输出端输出所述第二信号;所述下拉输出单元的第一端输入第三信号,所述下拉输出单元的第二端连接到所述移位寄存器输出端,所述下拉输出单元的控制端接收有效电平后,向所述移位寄存器输出端输出所述第三信号;在工作阶段,所述上拉输出单元的控制端接收有效电平;在复位阶段,所述下拉输出单元的控制端接收有效电平,所述第二时钟信号仅在复位阶段提供有效电平。2.根据权利要求1所述的驱动电路,其特征在于,所述下拉控制单元包括第一晶体管,所述第一晶体管的栅极输入所述第二时钟信号,所述第一晶体管的第一端连接到所述第一晶体管的栅极,所述第一晶体管的第二端连接所述下拉输出单元的控制端;在复位阶段,所述第二时钟信号控制所述第一晶体管导通,同时向所述第一晶体管的第一端输入所述第二时钟信号。3.根据权利要求1所述的驱动电路,其特征在于,所述上拉输出单元包括第二晶体管和第一电容,其中,所述第二晶体管的栅极为所述上拉输出单元的控制端,所述第二晶体管的第一端输入所述第二信号,所述第二晶体管的第二端为所述上拉输出单元的第二端,所述第一电容的第一极连接所述第二晶体管的栅极,所述第一电容的第二极连接所述第二晶体管的第二端;所述下拉输出单元包括第三晶体管和第二电容,其中,所述第三晶体管的栅极为所述下拉输出单元的控制端,所述第三晶体管的第一端输入所述第三信号,所述第三晶体管的第二端为所述下拉输出单元的第二端,所述第二电容的第一极连接所述第三晶体管的栅极,所述第二电容的第二极连接所述第三晶体管的第一端。4.根据权利要求1所述的驱动电路,其特征在于,所述上拉控制单元包括第四晶体管,所述第四晶体管的栅极输入所述第一时钟信号,所述第四晶体管的第一端输入所述第一信号,所述第四晶体管的第二端连接所述上拉输出单元的控制端。5.根据权利要求1所述的驱动电路,其特征在于,所述移位寄存器还包括:第一节点电位控制单元和第二节点电位控制单元,所述第一节点...
【专利技术属性】
技术研发人员:邬可荣,黄婉铭,沈亚华,
申请(专利权)人:厦门天马微电子有限公司,
类型:发明
国别省市:福建,35
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