本发明专利技术提供一种增大驱动能力以及恒定输出电流的控制电路及方法，包括：时间控制器、电流采样&控制器、逻辑&驱动器、晶体管Q1、晶体管Q2、晶体管Q3、电阻器R1、电阻器R2、电阻器R3、电容C1、二极管D、电感L以及电容C2。其优点在于使得输出电流不需要再流经晶体管Q1，从而提高系统效率和减小成本。
【技术实现步骤摘要】
一种增大驱动能力以及恒定输出电流的控制电路及方法
本专利技术涉及一种基于开关电源拓扑的增大驱动能力以及恒定输出电流的控制电路及方法。
技术介绍
图1是一种传统的基于开关电源拓扑的输出恒流电路图。如图1所示，传统的基于开关电源拓扑的输出恒流电路的控制方式由于电路结构简单，成本低；所以在LED恒流驱动电源中应用很广，但同样其缺点也非常明显，就是输出电流需要同时流过晶体管Q1和晶体管Q2。当输出电流比较大的情况下，就会在晶体管Q1上产生一定的损坏和发热；这样不但降低了系统效率还增加了成本。
技术实现思路
本专利技术提供了一种增大驱动能力以及恒定输出电流的控制电路及方法，使得输出电流不需要再流经Q1，从而提高系统效率和减小成本；从而克服现有技术的缺陷，解决上述技术问题。本专利技术提供一种增大驱动能力以及恒定输出电流的控制电路，包括：时间控制器、电流采样&控制器、逻辑&驱动器、晶体管Q1、晶体管Q2、晶体管Q3、电阻器R1、电阻器R2、电阻器R3、电容C1、二极管D、电感L以及电容C2；电阻器R3的一端连接晶体管Q1和晶体管Q3的源极以及电流采样&控制器的IN端，电流采样&控制器的OUT端连接逻辑&驱动器的IN1端，逻辑&驱动器的IN2连接时间控制器，逻辑&驱动器的OUT连接晶体管Q1的栅极，晶体管Q1的漏极连接电阻器R1的一端和晶体管Q2的栅极，电阻器R1的另一端连接电阻器R2的一端和VCC端，电阻器R2的另一端连接晶体管Q2的漏极与晶体管Q3的栅极，晶体管Q3的漏极连接电感L的一端与二极管D的一端，电感L的另一端连接电容C2的一端与Vo-端，二极管D2的另一端、电容C1和电容C2的另一端连接VIN端与Vo+端。进一步，本专利技术还提供一种增大驱动能力以及恒定输出电流的控制电路，还具有以下特征：晶体管Q2的源极、电容C1的另一端、电阻器R3的另一端连到地。进一步，本专利技术还提供一种增大驱动能力以及恒定输出电流的控制电路，还具有以下特征：晶体管Q1受逻辑&驱动器的控制，将逻辑&驱动器OUT脚送来的逻辑信号传送给晶体管Q2；电阻器R1将晶体管Q1的源极连接到VCC端，为晶体管Q1提供能量；晶体管Q2受晶体管Q1的控制，将晶体管Q1送来的驱动信号送至晶体管Q3；电阻器R2将晶体管Q2的源极连接到VCC端，为晶体管Q2提供能量；晶体管Q3受晶体管Q2的控制，控制电感L上的电流大小；电阻器R3将流过电感L的电流信号转换为电压信号并送到电流采样&控制器。另外，本专利技术还提供一种增大驱动能力以及恒定输出电流的控制方法，采用上述增大驱动能力以及恒定输出电流的控制电路；时间控制器，通过控制系统的关断时间实现控制输出电流。进一步，本专利技术还提供一种增大驱动能力以及恒定输出电流的控制方法，采用上述增大驱动能力以及恒定输出电流的控制电路；逻辑&驱动器，通过时间控制器和电流样&控制器送来的信号产生一PWM驱动信号去控制后级的电路。进一步，本专利技术还提供一种增大驱动能力以及恒定输出电流的控制方法，采用上述增大驱动能力以及恒定输出电流的控制电路；电阻器R1、电阻器R2，晶体管Q1、晶体管Q2，对逻辑&驱动器送来的PWM控制信号进行增大后去控制晶体管Q3，实现增大的驱动能力。进一步，本专利技术还提供一种增大驱动能力以及恒定输出电流的控制方法，采用上述增大驱动能力以及恒定输出电流的控制电路；电阻器R3采样到输出电流信号，并送至电流采样&控制器，电流采样&控制器将送到的输出电流信号，转换成对晶体管开通时间的控制信号送至逻辑&驱动器的IN1脚，时间控制器将根据输出电流的大小产生晶体管关断时间的控制信号送至逻辑&驱动器的IN2脚，逻辑&驱动器将根据时间控制器和电流采样&控制器分别送来的晶体管Q1开通时间控制信号与判断时间控制信号产品PWM调置信号，并送至后级，从而实现输出电流的控制。附图说明图1是一种传统的基于开关电源拓扑的输出恒流电路图。图2是本专利技术的一种增大驱动能力以及恒定输出电流的控制电路图。具体实施方式：以下结合附图和具体实施例，对本专利技术做进一步说明。图2是本专利技术的一种增大驱动能力以及恒定输出电流的控制电路图。如图2所示，一种增大驱动能力以及恒定输出电流的控制电路，包括：时间控制器、电流采样&控制器、逻辑&驱动器、晶体管Q1、晶体管Q2、晶体管Q3、电阻器R1、电阻器R2、电阻器R3、电容C1、二极管D、电感L以及电容C2。电阻器R3的一端连接晶体管Q1和晶体管Q3的源极以及电流采样&控制器的IN端；另一端接地。电流采样&控制器的OUT端连接逻辑&驱动器的IN1端。逻辑&驱动器的IN2连接时间控制器。逻辑&驱动器的OUT连接晶体管Q1的栅极。晶体管Q1的漏极连接电阻器R1的一端和晶体管Q2的栅极。电阻器R1的另一端连接电阻器R2的一端和VCC端。电阻器R2的另一端连接晶体管Q2的漏极与晶体管Q3的栅极。晶体管Q2的源极接地。晶体管Q3的漏极连接电感L的一端与二极管D的正极，电感L的另一端连接电容C2的一端与Vo-端。二极管D2的负极、电容C1和电容C2的另一端连接VIN端与Vo+端。电容C1的另一端接地。晶体管Q1受逻辑&驱动器的控制，将逻辑&驱动器OUT脚送来的逻辑信号传送给晶体管Q2。电阻器R1将晶体管Q1的源极连接到VCC端，为晶体管Q1提供能量。晶体管Q2受晶体管Q1的控制，将晶体管Q1送来的驱动信号送至晶体管Q3。电阻器R2将晶体管Q2的源极连接到VCC端，为晶体管Q2提供能量。晶体管Q3受晶体管Q2的控制，控制电感L上的电流大小。电阻器R3将流过电感L的电流信号转换为电压信号并送到电流采样&控制器。一种增大驱动能力以及恒定输出电流的控制方法：时间控制器通过控制系统的关断时间实现控制输出电流。逻辑&驱动器，通过时间控制器和电流样&控制器送来的信号产生一PWM驱动信号去控制后级的电路。电阻器R1、电阻器R2，晶体管Q1、晶体管Q2，对逻辑&驱动器送来的PWM控制信号进行增大后去控制晶体管Q3，实现增大的驱动能力。电阻器R3采样到输出电流信号，并送至电流采样&控制器，电流采样&控制器将送到的输出电流信号，转换成对晶体管开通时间的控制信号送至逻辑&驱动器的IN1脚，时间控制器将根据输出电流的大小产生晶体管关断时间的控制信号送至逻辑&驱动器的IN2脚，逻辑&驱动器将根据时间控制器和电流采样&控制器分别送来的晶体管Q1开通时间控制信号与判断时间控制信号产品PWM调置信号，并送至后级，从而实现输出电流的控制。本说明书中所描述的只是本专利技术的优选具体实施例，以上实施例仅用以说明本专利技术的技术方案而非对本专利技术的限制。凡本领域技术人员依本专利技术的构思通过逻辑分析、推理或者有限的实验可以得到的技术方案，皆应在如权利要求所界定的本专利技术的范围之内。本文档来自技高网...
【技术保护点】
1.一种增大驱动能力以及恒定输出电流的控制电路，其特征在于：包括，时间控制器、电流采样&控制器、逻辑&驱动器、晶体管Q1、晶体管Q2、晶体管Q3、电阻器R1、电阻器R2、电阻器R3、电容C1、二极管D、电感L以及电容C2；其中，电阻器R3的一端连接晶体管Q1和晶体管Q3的源极以及电流采样&控制器的IN端，电流采样&控制器的OUT端连接逻辑&驱动器的IN1端，逻辑&驱动器的IN2连接时间控制器，逻辑&驱动器的OUT连接晶体管Q1的栅极，晶体管Q1的漏极连接电阻器R1的一端和晶体管Q2的栅极，电阻器R1的另一端连接电阻器R2的一端和VCC端，电阻器R2的另一端连接晶体管Q2的漏极与晶体管Q3的栅极，晶体管Q3的漏极连接电感L的一端与二极管D的一端，电感L的另一端连接电容C2的一端与Vo‑端，二极管D2的另一端、电容C1和电容C2的另一端连接VIN端与Vo+端。
【技术特征摘要】
1.一种增大驱动能力以及恒定输出电流的控制电路，其特征在于：包括，时间控制器、电流采样&控制器、逻辑&驱动器、晶体管Q1、晶体管Q2、晶体管Q3、电阻器R1、电阻器R2、电阻器R3、电容C1、二极管D、电感L以及电容C2；其中，电阻器R3的一端连接晶体管Q1和晶体管Q3的源极以及电流采样&控制器的IN端，电流采样&控制器的OUT端连接逻辑&驱动器的IN1端，逻辑&驱动器的IN2连接时间控制器，逻辑&驱动器的OUT连接晶体管Q1的栅极，晶体管Q1的漏极连接电阻器R1的一端和晶体管Q2的栅极，电阻器R1的另一端连接电阻器R2的一端和VCC端，电阻器R2的另一端连接晶体管Q2的漏极与晶体管Q3的栅极，晶体管Q3的漏极连接电感L的一端与二极管D的一端，电感L的另一端连接电容C2的一端与Vo-端，二极管D2的另一端、电容C1和电容C2的另一端连接VIN端与Vo+端。2.如权利要求1所述的增大驱动能力以及恒定输出电流的控制电路，其特征在于：其中，晶体管Q2的源极、电容C1的另一端、电阻器R3的另一端连到地。3.如权利要求1所述的增大驱动能力以及恒定输出电流的控制电路，其特征在于：其中，晶体管Q1受逻辑&驱动器的控制，将逻辑&驱动器OUT脚送来的逻辑信号传送给晶体管Q2；电阻器R1将晶体管Q1的源极连接到VCC端，为晶体管Q1提供能量；晶体管Q2受晶体管Q1的控制，将晶体管Q1送来的驱动信号送至晶体管Q3；电阻器R2将晶体管Q2的源极连接到VCC端，为晶体管Q2提供能量；晶体管Q3受晶体...
【专利技术属性】
技术研发人员：张义，
申请(专利权)人：张义，
类型：发明
国别省市：安徽,34
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