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一种比较器，具备：与时钟信号（CLK）同步地导通/截止的晶体管（M0）、与晶体管（M0）的导通/截止同步地进行比较动作的差动对（M1、M2）、输出差动对（M1、M2）的比较结果的正反馈部（F1），正反馈部具备：在PMOS晶体管（M3）与NM...
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