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本发明公开了一种用于去除LVDS信号的展频的系统,包括输入LVDS信号采集模块、第一锁相环、时钟检测模块、FIFO缓冲器、控制处理器、第二锁相环和输出LVDS信号合成模块,其中,所述控制处理器接收所述时钟检测模块发送的关于同步信号的有效数据...该专利属于广州视源电子科技股份有限公司所有,仅供学习研究参考,未经过广州视源电子科技股份有限公司授权不得商用。
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本发明公开了一种用于去除LVDS信号的展频的系统,包括输入LVDS信号采集模块、第一锁相环、时钟检测模块、FIFO缓冲器、控制处理器、第二锁相环和输出LVDS信号合成模块,其中,所述控制处理器接收所述时钟检测模块发送的关于同步信号的有效数据...