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本发明涉及全数字解调中无时钟提取的位同步系统，由ADC模块、零值滤波模块一和二、毛刺滤波模块一和二、有效时刻提取模块、误差信号提取模块、插值计算模块一和二、控制信号计算模块和输出整型模块组成。ADC模块以发端数据带宽N倍对模拟信号采样后的两...
该专利属于西安电子科技大学所有，仅供学习研究参考，未经过西安电子科技大学授权不得商用。

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