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一种高速串行接口的多相时钟产生电路中采用的鉴相和启动电路，包括具有三个输入端和两个输出端的鉴相器和连接于鉴相器输入端的启动电路，该启动电路包含一与门、第一～三D触发器、第一～三CML2CMOS电路及第一～三缓冲器。本发明电路在多相时钟产生电...
该专利属于清华大学深圳研究生院所有，仅供学习研究参考，未经过清华大学深圳研究生院授权不得商用。

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