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一种基于改进型三阶段逻辑的功耗恒定型D触发器电路制造技术
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下载一种基于改进型三阶段逻辑的功耗恒定型D触发器电路的技术资料
文档序号:43338501
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本发明公开一种基于改进型三阶段逻辑的功耗恒定型D触发器电路,包括八个PMOS管P1~P8、十一个NMOS管N1~N11和一个双输入与非门。为了提高电路的硬件安全水平和抗功耗攻击性能,降低触发器的功耗和延迟,本发明基于DyCML结构,提出基于...
该专利属于杭州师范大学所有,仅供学习研究参考,未经过杭州师范大学授权不得商用。
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