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本发明公开了一种基于FPGA的多路并行信号处理系统与方法，属于测试技术领域，本发明系统包括多个信号处理单元、多个时钟整形单元、参考时基单元和主处理单元；多个信号处理单元和主处理单元之间通过通讯总线连接，参考时基单元和多个时钟整形单元之间通过...
该专利属于中电科思仪科技股份有限公司所有，仅供学习研究参考，未经过中电科思仪科技股份有限公司授权不得商用。

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