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本申请提供一种多位数相位累加器。包括：复位控制模块、级联分频器模块和同步输出模块；所述级联分频器模块包括真单相时钟分频器子模块和电流模逻辑分频器子模块；所述复位控制模块与所述级联分频器模块连接，用于产生正相置位信号和反相置位信号；所述级联分...
该专利属于北京邮电大学所有，仅供学习研究参考，未经过北京邮电大学授权不得商用。

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