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本发明公开了一种时钟同步电路、系统及方法,电路包括:时钟信号耦合模块,包括第一电容单元和第二电容单元,第一电容单元用于基于第一时钟信号获得第一表征信号,第二电容单元基于第一时钟信号获得第二表征信号;比较模块,用于基于第一表征信号和第一基准电...该专利属于思瑞浦微电子科技(上海)有限责任公司所有,仅供学习研究参考,未经过思瑞浦微电子科技(上海)有限责任公司授权不得商用。
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