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本发明公开了一种基于桶状缓冲处理结构的并行快时间维恒虚警实现方法，应用于FPGA中，方法包括：将动目标检测单元输出的由距离维、多普勒维两个维度表征的第一数据转化为由距离维、多普勒维、子多普勒维三个维度表征的第二数据；利用串并转换模块将第二数...
该专利属于西安电子科技大学所有，仅供学习研究参考，未经过西安电子科技大学授权不得商用。

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