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比较时钟产生电路及用于规避比较器亚稳态的方法技术
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文档序号:40517108
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本申请涉及集成电路技术领域,公开一种比较时钟产生电路,包括:比较器,输入端接收输出电压信号,输出端输出逻辑信号;与门,输入端与比较器的输出端连接;延迟单元,输入端与门输出端连接,输出端与比较器的时钟信号输入端连接;以对与门输出信号进行延迟,...
该专利属于紫光同芯微电子有限公司所有,仅供学习研究参考,未经过紫光同芯微电子有限公司授权不得商用。
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