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并行阵列式帧内预测解码器VLSI结构设计方法技术
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文档序号:4043087
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本发明公开了一种并行阵列式帧内预测解码器的设计方法,采用帧内并行阵列技术,实现子宏块并行解码,提高帧内宏块的解码效率;采用多预测模式复用技术,实现的帧内预测计算单元PE。每个子宏块中以4个PE单元并行预测4个像素;采用自适应流水线技术,实现...
该专利属于西安交通大学所有,仅供学习研究参考,未经过西安交通大学授权不得商用。
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