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面向芯片设计的IO时序优化方法及装置制造方法及图纸
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下载面向芯片设计的IO时序优化方法及装置的技术资料
文档序号:40273306
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本申请涉及一种面向芯片设计的IO时序优化方法及装置。通过校准模块进行初始化校准,获得延迟模块的默认延迟大小,再在芯片正常工作时,利用CPU计算IO接口的实际时序与优化目标的时序偏差,根据默认延迟大小进一步计算出所需的延迟单元配置值,然后配置...
该专利属于湖南长城银河科技有限公司所有,仅供学习研究参考,未经过湖南长城银河科技有限公司授权不得商用。
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