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本发明公开了一种无毛刺数字延迟链，属于集成电路数字技术领域。其包括可配置选通模块、时钟门控模块和多级延迟单元串联组成的延迟线，其中延迟单元由延迟电路和选通模块组成。本发明利用CMOS工艺基本单元来实现链路的延迟，采用两个完全对称延迟电路和反...
该专利属于中国电子科技集团公司第五十四研究所所有，仅供学习研究参考，未经过中国电子科技集团公司第五十四研究所授权不得商用。

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