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本公开涉及用于高速信令互连的硬件中的错误率中断。接收器设备包括检测逻辑、错误计数器和中断逻辑。检测逻辑用于接收第一组数据帧并且检测所述第一组数据帧中的一个或更多个帧错误。错误计数器用于存储在第一组数据帧中检测到的所述一个或更多个帧错误的数量...
该专利属于辉达公司所有，仅供学习研究参考，未经过辉达公司授权不得商用。

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