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本公开涉及集成电路技术领域，提供一种异步桥、SOC、电子组件、电子设备及芯片设计方法，旨在不影响数据传输速度的情况下，尽量减小FIFO存储器的所占面积。其中，异步桥包括数据通道，数据通道包括设置在第一时钟域的FIFO存储器，FIFO存储器用...
该专利属于北京象帝先计算技术有限公司所有，仅供学习研究参考，未经过北京象帝先计算技术有限公司授权不得商用。

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