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本发明涉及模拟集成电路设计领域，具体为一种自适应比较器延时环路的SAR ADC，可应用于超高速SARADC。本发明根据DAC电容阵列里MSB到LSB建立时间的不一致，通过设置环路延时模块的可调延时级的级数N，使得比较器在第一次比较后，将后续...
该专利属于电子科技大学所有，仅供学习研究参考，未经过电子科技大学授权不得商用。

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