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根据本发明的一个实施例，提供一种并行ＳＣ ＡＤＣ（开关电容模数转换器），其中包括由总时钟相位（Φ）所控制的被动采样技术，以减小采样相位偏移。由于不需要运算放大器来用于采样，因此它非常适合于高速应用中，并且可以在高速并行ＳＣ ＡＤＣ中把与...
该专利属于艾利森电话股份有限公司所有，仅供学习研究参考，未经过艾利森电话股份有限公司授权不得商用。

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