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在芯片内部集成电阻电容乘积的时间常数测试电路制造技术
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文档序号:3406741
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本发明涉及一种在芯片内部集成电阻电容乘积的时间常数测试电路,包括有源RC滤波器,RC有源滤波器与滤波器设计中的各个极点关联的RC电路结构单元构成的各个单阶RC中增加可控单元阵列。可控单元阵列为与常规RC单元连接并且可以改变RC时间常数的调整...
该专利属于尹登庆所有,仅供学习研究参考,未经过尹登庆授权不得商用。
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