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本发明公开一种数据先进先出(FIFO)电路，其包含缓存器单元、多个数据复用器以及输出复用器。所述缓存器单元包含多个译码器和N多个缓存器。所述译码器被用于响应于多个相应的输入控制信号和至少一个输入启动信号而输出多个译码信号。所述N多个缓存器被...
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