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在关状态无漏电流的半导体器件及其制造方法技术
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文档序号:3221037
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在包括元件区50和元件隔离区58的半导体器件中,含氮氧化硅膜68置于元件区50与元件隔离区58之间的边界处。在制备半导体器件的方法中,在提供元件区50的半导体衬底60的部分表面上形成掩模材料72和74,使用掩模材料72和74腐蚀半导体衬底6...
该专利属于日本电气株式会社所有,仅供学习研究参考,未经过日本电气株式会社授权不得商用。
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