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一种实时时钟的中断测试电路制造技术
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文档序号:31641972
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本实用新型揭示了一种实时时钟的中断测试电路,通过处理器连接实时时钟芯片控制启闭中断信号,并由处理器通过GPIO输出中断脉冲,其特征在于:该GPIO的输出端与输入电压VDD之间接设有LED与电阻R1串联的支路;且在所述处理器与输入电压VDD之...
该专利属于宜宾芯汇信息科技有限公司所有,仅供学习研究参考,未经过宜宾芯汇信息科技有限公司授权不得商用。
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