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本发明提供了一个具有提高的运行速度和只需有限布局面积的ＳＤＲＡＭ。在同步ＤＲＡＭ中，至少一部分要连续执行的信号处理分为众多步骤，该众多步骤与外加的外部时钟保持同步而并行地执行，因而提高运行速度。该同步ＤＲＡＭ包括众多用于并行地执行众多步骤的...
该专利属于富士通株式会社所有，仅供学习研究参考，未经过富士通株式会社授权不得商用。

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