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本发明公开了用于总线接口装置的负电压保护。描述了总线接口总线。在总线上，第一逻辑状态由较高电压电平传达并且第二逻辑状态由较低电压电平传达。接口的输出级包括：功率晶体管，该功率晶体管被配置成将较低电压电平驱动至总线上以传达第二逻辑状态；以及在...
该专利属于赛普拉斯半导体公司所有，仅供学习研究参考，未经过赛普拉斯半导体公司授权不得商用。

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