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本发明属于集成电路技术领域，具体涉及一种用于时间交织ADC采样时间失配的提取方法。该方法通过拉长计算相关函数时的通道间隔实现对抑制时间失配的提取误差，从而实现高精度的时间失配提取，该方法易于实现且消耗的资源与传统方法几乎一样。该方法可有效减...
该专利属于电子科技大学所有，仅供学习研究参考，未经过电子科技大学授权不得商用。

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