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一种在微处理器中的分支控制装置。此装置包括分支目标地址高速缓存，用以高速分支指令是否涵盖跨越二条高速线的指示。当含有分支指令的第一部分的第一高速线的指令高速缓存提取地址击入分支目标地址高速缓存时，分支目标地址高速缓存会输出分支指令的目标地址...
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