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作为产生功能上等同于已经被编程执行用户的逻辑设计的ＦＰＧＡ的结构化ＡＳＩＣ的一部分，编译已经为ＡＳＩＣ实现所准备的那个设计被转换为结构化ＡＳＩＣ的物理布局。这个物理布局的产生兑现用户提供的定时约束条件，并且也保持功能上等同于参考的编程ＦＰＧ...
该专利属于阿尔特拉公司所有，仅供学习研究参考，未经过阿尔特拉公司授权不得商用。

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