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整数模式数字锁相环的摆动减少制造技术
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文档序号:25845878
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电路包括时间‑数字转换器(TDC)(102),以产生输出信号,该输出信号是到TDC(102)的第一输入时钟和到TDC(102)的第二输入时钟之间的时间差的函数。第一延迟线(502)将时间延迟加到第三时钟以产生第一输入时钟。伪随机二进制序列发...
该专利属于德克萨斯仪器股份有限公司所有,仅供学习研究参考,未经过德克萨斯仪器股份有限公司授权不得商用。
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