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文档序号:24808231
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提供一种抑制了电流路径的电阻值的偏差的半导体装置。提供具备具有并联连接的多个第一电路部的第一电路块、具有并联连接的多个第二电路部的第二电路块以及将第一电路块与第二电路块电连接的块间连接部的半导体装置,块间连接部具有电阻调整部,所述电阻调整部...
该专利属于富士电机株式会社所有,仅供学习研究参考,未经过富士电机株式会社授权不得商用。
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